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FPGA-Partitionierung (Ulrich Weinmann)

Beim Entwurf digitaler Schaltungen ist die Validierungszeit zu einem entscheidenden Kosten- und Zeitfaktor geworden. Hierbei kann eine aufwendige Simulation durch eine realitätsnahe Emulation auf programmierbaren Bausteinen ergänzt werden. Die zunehmende Komplexität bei zugleich steigendem Flächenbedarf digitaler Schaltungen erfordert im allgemeinen eine Aufteilung (Partitionierung) auf mehrere programmierbare Bausteine.

Im Berichtszeitraum wurde eine automatisierte Implementierung von Schaltungen durch Prototypsysteme mit mehreren programmierbaren Bausteinen realisiert. Das Programmsystem COSY geht von einer Gatter- oder Register-Transfer-Beschreibung aus und kann eine Partitionierung unter Benutzervorgaben (Zeitverhalten, ...) durchführen. Entscheidend ist hierbei die Einhaltung Baustein-spezifischer Randbedingungen wie Anschluß- oder Gatteranzahl.



Steffen Wieschalla
Fri Apr 25 18:56:55 MET DST 1997